waferhit 发表于 2019-5-9 15:08:08

verilog看门狗计时器寄存器变量保存问题?

条件:quartus ii 12.0. CPLD/5M570系列,clk时钟40MHz。 count_r为18位宽。踢狗周期2.5ms左右。

信号说明:i_dogOff 为看门狗禁用。i_wdog !=1 为踢狗信号。 BACT_r为看门狗输出,故障时持续低电平。

问题现象:
注释//count_r<=WDG; 看门狗不能正常够做。
不注释count_r<=WDG;,看门狗正常工作。

按照我的理解,当计数器if(count_r>=WDG) 为真,count_r不会进入else 自加了。所以这条语句应该可以省略啊。

而且,如果看门狗及时踢狗的话,也进入不了if(count_r>=WDG) 语句。

但是实测确实不能注释该语句,一直理解不了。


示波器信号说明:黄色 为踢狗, 浅蓝色和紫色为count_r , 深蓝色为BACT_r.

示波器突然会出现count_r异常。
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