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(OSHW) 低成本 100k LCR meter,基于数字解调算法

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出0入0汤圆

发表于 2016-10-13 18:37:22 | 显示全部楼层 |阅读模式
本帖最后由 一天的蓝 于 2016-10-13 18:37 编辑

前篇:基于FFT算法的LCR http://www.amobbs.com/thread-5590156-1-1.html

频率范围:1Hz~100kHz  ( 0.01Hz step );
阻抗范围:10m~10M Ohm ( 1k ref only );

丢掉PSD和PGA,忘掉DFT、FFT和LMS算法吧,只需2个运放 + ADC/DAC,100k lcr meter带回家
核心算法类似soft define radio 中的数字下变频(数字IQ解调),更准确的定义是 DLIA(Digital Lock-in amplifier,数字锁定放大器);
其实就是将原来模拟器件完成的信号处理整个搬到了数字域,利用浮点运算能力 降低硬件复杂程度,
相对于PSD方法,动态范围更高,当信号转换到数字域后,就无需再考虑噪声和失调,动态范围超过100dB;
相对于FFT、LMS算法,16bit 4096point 已经算比较高了,而DLIA可以用浮点的 乘法器/CIC/FIR/IIR,DFT:Vi/Vq = 4095/0,DLIA: Vi/Vq = 4.0952341E3 / 1.234354E-2;
此外 n=4096 fs=100khz 的FFT 分辨率≈24hz,而DLIA 不存在限制 举个栗子:80,000.00 Hz ~ 80,001.00 Hz扫频,分辨率0.01Hz;

自己绕的变压器:






10nF 1kHz 1%建立时间:



更多图片

硬件相关:
  标准(100k):
    4 x OPA + 2 x ADC + 1 x DAC + MCU (> 80 DMIPS);
  最低(20k):
    2 x OPA + USB Audio Codec (such as PCM2904);
  开发版(100k):
    主控制器:STM32F411CE ( > 80 DMIPS), CNY 24
    ADC/DAC:TLV320AIC3204 (TI audio codec), CNY 10
    AFE:AD8065, 4 x CNY 4
    DEBUGGER:CMSIS-DAP for STM32F072 with CDC / J-Link OB-STM32F072-CortexM, CNY 20
    接口:USB VCP (via DEBUGGER) or 蓝牙串口 (Simple Shell, Data format: JSON)
    Hardware:100k ZLCR.rev.c.pdf
    Software:Firmware for stm32f4xx
  
软件相关:
  Python / C# / Matlab / Windows UWP

  通信格式:
   
  1. uart tx:
  2.   zlcr -raw -f 1000\n
  3. uart rx:
  4.   {"FREQ":1.000000e+03,"a":-2.304493e+03,"b":-5.388904e+03,"c":-2.319749e+03,"d":-5.420242e+03}\n
  5.   {"FREQ":1.000000e+03,"a":-2.304510e+03,"b":-5.388904e+03,"c":-2.319749e+03,"d":-5.419875e+03}\n
  6.   {"FREQ":1.000000e+03,"a":-2.304507e+03,"b":-5.388909e+03,"c":-2.319749e+03,"d":-5.421182e+03}\n
  7.   {"FREQ":1.000000e+03,"a":-2.304502e+03,"b":-5.388918e+03,"c":-2.319749e+03,"d":-5.423528e+03}\n
  8. uart tx:
  9.   zlcr -f 1000\n
  10. uart rx:
  11.   {"FREQ":1.000000e+03,"MAG":9.937274e-01,"PHASE":-1.291339e-04}\n
  12.   {"FREQ":1.000000e+03,"MAG":9.940118e-01,"PHASE":-2.515127e-04}\n
  13.   {"FREQ":1.000000e+03,"MAG":9.941343e-01,"PHASE":-3.042429e-04}\n
  14.   {"FREQ":1.000000e+03,"MAG":9.939352e-01,"PHASE":-2.185376e-04}\n
复制代码


扩展(up to 20M):
  运放构成的auto-balancing bridge并不适合100k以上的测试频率,所以设计了数字桥路平衡控制系统,产生两个激励信号(2 x AD9834) ,通过检测不平衡电压/电流(HPF + 40dB AMP + DLIA),由控制算法调整激励信号幅度和相位,使桥路趋近平衡;同时利用ADC + DLIA 检测V(DUT) & I(DUT),计算复阻抗,测量结果在桥路达到平衡后误差最小;
  ADC采样率和计算量增大的问题,解决方案是欠采样(中频采样)。大学时候做过STM32F4欠采样第20奈奎斯特区 观察到明显的孔径抖动 SNR会降低,再往上bandwidth就不够了。对于V(DUT) I(DUT)这种窄带信号,欠采样 + PSD/DLIA 是性能和成本的平衡;
  对于ΣΔADC,设计了简单的采样保持器 ( 4 x TS5A3159A 未验证);
  此外AD9834不能控制幅度,设计通过PWM(AF OD mode)调整 I(FSADJSET) 进行幅度控制,相位利用抖动实现16bit;
  最后,发个还未验证的版本 20M ZLCR.rev.a.pdf

ref:
  Keysight Technologies Impedance Measurement Handbook
  抛砖引玉 基于DSP的LCR表试制 供大家参考
  MT-002: 奈奎斯特准则对数据采样系统设计有何意义
  MS-2698:使用同步检测进行精密低电平测量
  基于DLIA的交流阻抗谱测量系统关键技术研究

阿莫论坛20周年了!感谢大家的支持与爱护!!

一只鸟敢站在脆弱的枝条上歇脚,它依仗的不是枝条不会断,而是自己有翅膀,会飞。

出0入0汤圆

发表于 2016-10-13 18:44:01 | 显示全部楼层
mark,这个要顶

出0入0汤圆

 楼主| 发表于 2016-10-13 19:15:42 | 显示全部楼层
本帖最后由 一天的蓝 于 2016-10-13 19:39 编辑

补充图片:









核心在DSP算法上面,硬件非常简单 没有计划发套件 后续应该会传geber到github
rev.b版本精度稍低一点,没蓝牙ssp,空板有一些,rev.c还没打样,有兴趣玩的朋友联系我啊
一直在尝试用软件运算代替硬件,以一些初步成果嘿嘿:
  1MSPS DDS core (Archive)
  100k LCR meter, base on DLIA (Archive)
  20M LCR meter, base on DLIA
  IR Tof, base on DPSD (Archive)
  HART Modem base on stm32 pwm
下一步准备玩SDR 和上面发的 20M LCR

刚毕业,专业英语非常6但交流不能,TI投了两次不让过,下周去深圳找工作,以下简历,求建议啊!行业究竟先看前景还是喜好,薪资待遇等等,,
普通二本,专注模拟信号和数字信号调理,测试测量,熟悉stm32,大学4年实验室,社团负责人,大一拿电赛国二大三拿国一(初中开始玩运放晶体管了),做过大小项目不计其数,求建议!

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出50入0汤圆

发表于 2016-10-13 19:29:57 | 显示全部楼层
牛逼啊,对比楼主我只能汗颜。

出0入0汤圆

发表于 2016-10-13 19:31:38 来自手机 | 显示全部楼层
有套件么,报名

出0入0汤圆

发表于 2016-10-13 19:37:23 | 显示全部楼层
这个看起来能做网络分析扫频测试吗?

出0入0汤圆

发表于 2016-10-13 19:37:38 | 显示全部楼层
LZ毕业设计?

出0入0汤圆

发表于 2016-10-13 19:39:18 | 显示全部楼层
深圳这房价楼主还来入坑

出0入0汤圆

 楼主| 发表于 2016-10-13 19:45:37 | 显示全部楼层

没有计划开车啊,板子在打样呢,过几天发geber~
其实硬件简单,自己画个精简版的更方便,代码基本不用改

出0入0汤圆

 楼主| 发表于 2016-10-13 19:48:40 | 显示全部楼层
LQS1200 发表于 2016-10-13 19:37
这个看起来能做网络分析扫频测试吗?

可以测无源两端网络,四端要接GND出来,可以得到频率特性,但输出输入阻抗不是50,硬件稍改一下可以当做低频的网分

出0入0汤圆

 楼主| 发表于 2016-10-13 19:51:15 | 显示全部楼层

是毕设的一部分,还有100k示波器和信号发生器,8ch 数字IO,  补个上位机:

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出0入0汤圆

发表于 2016-10-13 19:53:44 | 显示全部楼层
一天的蓝 发表于 2016-10-13 19:51
是毕设的一部分,还有100k示波器和信号发生器,8ch 数字IO,  补个上位机:

...

上位机用MFC写的?

出0入0汤圆

发表于 2016-10-13 19:55:38 | 显示全部楼层
一天的蓝 发表于 2016-10-13 19:48
可以测无源两端网络,四端要接GND出来,可以得到频率特性,但输出输入阻抗不是50,硬件稍改一下可以当做 ...

网分这个好,一般没条件测,LCR就有

出0入0汤圆

 楼主| 发表于 2016-10-13 19:57:20 | 显示全部楼层

WPF程序 .Net 4.5 C#,现在多写UWP的 方便手机用~

出0入0汤圆

 楼主| 发表于 2016-10-13 20:02:28 | 显示全部楼层
LQS1200 发表于 2016-10-13 19:55
网分这个好,一般没条件测,LCR就有

真要用网分的情况 频率就太高啦,100k根本是零头,,做过的谱分最高才到50M,因为没学FPGA~

出90入4汤圆

发表于 2016-10-13 20:24:18 来自手机 | 显示全部楼层
收藏下,有时间搞个玩下。

出0入0汤圆

发表于 2016-10-13 20:35:21 | 显示全部楼层
一天的蓝 发表于 2016-10-13 20:02
真要用网分的情况 频率就太高啦,100k根本是零头,,做过的谱分最高才到50M,因为没学FPGA~ ...

几M,10M就好,总比没有好

出0入0汤圆

发表于 2016-10-13 20:55:08 来自手机 | 显示全部楼层
楼主订板子一套,谢谢

出0入0汤圆

发表于 2016-10-13 21:03:34 | 显示全部楼层

楼主好赛雷!

真想不出是来自广西贺州学院的! 广西桂电好像也很多人才!

出0入0汤圆

发表于 2016-10-13 21:30:42 来自手机 | 显示全部楼层
楼主出个套件肯定不少人上车

出0入0汤圆

 楼主| 发表于 2016-10-13 21:36:04 | 显示全部楼层
ANHOME 发表于 2016-10-13 21:03
楼主好赛雷!

真想不出是来自广西贺州学院的! 广西桂电好像也很多人才! ...

  桂电师资设备不错的,毕竟也是中国的4个电科之一,可惜偏科严重 高考分数没够~

出0入0汤圆

发表于 2016-10-13 21:57:41 来自手机 | 显示全部楼层
卧槽,楼主厉害了!

出20入25汤圆

发表于 2016-10-13 21:58:49 来自手机 | 显示全部楼层
楼主,精度有分析过么

出0入0汤圆

发表于 2016-10-13 22:11:33 | 显示全部楼层
赞一个,话说楼主简历投TI不适合写STM32吧,写ARM Cortex-M更好

出20入25汤圆

发表于 2016-10-13 22:20:59 | 显示全部楼层
eleqian 发表于 2016-10-13 22:11
赞一个,话说楼主简历投TI不适合写STM32吧,写ARM Cortex-M更好

TI 口语不行也是白搭,上过当。

出0入0汤圆

发表于 2016-10-13 22:34:02 | 显示全部楼层
看到楼主刚毕业就这么牛逼,我突然感觉中国有希望了

出0入9汤圆

发表于 2016-10-13 23:08:34 | 显示全部楼层
这个应该顶,楼主肯定能找份满意的工作。

出0入0汤圆

 楼主| 发表于 2016-10-13 23:11:08 | 显示全部楼层
本帖最后由 一天的蓝 于 2016-10-13 23:16 编辑
chenchaoting 发表于 2016-10-13 21:58
楼主,精度有分析过么


简单分析过,matlab做的,微弱信号放大/模拟锁相放大器/相干检测的理论非常成熟,转为数字信号处理规避了噪声和失调问题,动态范围更大,只要抽取、IIR滤波器设计的合理就不会降低精度(不造成混叠),不过IIR滤波器是无限冲击响应 是不稳定地, 最后采用的2个4阶椭圆IIR级联,并两次抽取,FIR滤波器会更稳定,也更容易抽取,但计算量比较大;比较合理的设置是CIC+抽取FIR+IIR。总之当信号量化到数字域后,就无需再考虑很多误差了,所以关键在于数字前端 ADC 以及模拟前端部分,布局注意信号线走向,尽量减小幅度和相位不平衡就可以,即使输入信号小到低于1LSB,DLIA也能一定程度地解调出信号。理论上说用 SAR ADC 也适合,只是还没有测试,以下是SAR ADC 加了量化噪声的模拟:



10nF x7r 电容的测试,相位接近90°了,看副参稳不稳定可知(Rs、D):



最后做出实物的确还比较准,但没有标定 所以不敢说精度,但从原理上说 相对本振是方波的模拟PSD方案,DLIA的本振是16bit (or float) 余弦波,数字滤波器性能更好;相对FFT的方法,硬件无需改动 换个算法 动态范围能扩大许多倍,所以100k以下,DLIA算法的精度应当是超过传统方法的;
更重要的是,设计的硬件没有量程切换,没有使用内部PGA,没有进行开路/短路/标定,也就是说用1k欧电阻测到10m~10M 9个数量级180dB的动态范围!
经过测试在2s内达到1%建立的测量范围超过140dB(100m~1M),类比模拟信号的话 就是1Vrms的50Hz信号中检出100nVrms的51Hz信号,,
没有进行标定的原因是:毕业了,没有示波器没有标准电阻标准信号等等等,,只有一个能测频率的万用表!眼泪掉下来,,

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出0入0汤圆

发表于 2016-10-14 05:23:49 来自手机 | 显示全部楼层
这个牛。支持一下楼主。

出0入0汤圆

发表于 2016-10-14 10:19:29 | 显示全部楼层
顶,搞个套件吧

出0入24汤圆

发表于 2016-10-14 11:13:26 | 显示全部楼层
很好,学习DLIA

另外AD9834是可以做幅度控制的,ADI有文档的

出20入25汤圆

发表于 2016-10-14 12:37:08 | 显示全部楼层
一天的蓝 发表于 2016-10-13 23:11
简单分析过,matlab做的,微弱信号放大/模拟锁相放大器/相干检测的理论非常成熟,转为数字信号处理规避了 ...

支持楼主,不过你们学校也够设备艰苦。能做成这样很不错了

出10入18汤圆

发表于 2016-10-14 13:16:10 来自手机 | 显示全部楼层
读研出国吧

出0入0汤圆

发表于 2016-10-14 13:28:14 | 显示全部楼层
很精彩,

出0入25汤圆

发表于 2016-10-14 13:39:31 | 显示全部楼层

楼主厉害,,向楼主学习

出0入0汤圆

发表于 2016-10-14 13:59:16 | 显示全部楼层
牛b!!!!

出0入0汤圆

 楼主| 发表于 2016-10-14 14:02:39 | 显示全部楼层
20061002838 发表于 2016-10-14 11:13
很好,学习DLIA

另外AD9834是可以做幅度控制的,ADI有文档的

谢谢提醒!还是找资料不够仔细啊~ CN0156:用于AD9834波形发生器(DDS)的幅度控制电路
通过DAC调整I(ADJUST)电流,与我的设计异曲同工,但用DAC精度会更好些,考虑添加!

@chenchaoting:学校设备还好了,,6位半 LCR 网分都有,只是毕业这段时间没这条件了,,

出0入0汤圆

发表于 2016-10-14 15:37:32 | 显示全部楼层
收藏了。准备试 试

出0入85汤圆

发表于 2016-10-14 16:25:47 | 显示全部楼层
膜拜一下,看LZ的算法搞的这么炉火纯青,弱弱的问一句,用DSP实现sigma delta的ADC好搞不?

出0入0汤圆

 楼主| 发表于 2016-10-14 17:36:59 | 显示全部楼层
本帖最后由 一天的蓝 于 2016-10-14 18:03 编辑
marshallemon 发表于 2016-10-14 16:25
膜拜一下,看LZ的算法搞的这么炉火纯青,弱弱的问一句,用DSP实现sigma delta的ADC好搞不? ...


做过,好搞!但并不是 Σ-Δ 调制器,那是比较器积分器锁存器来着,它的输出是脉冲密度调制信号(PDM),可以用软件解调出PCM,st有个PDM库,专门干这个;
我的方案:硬件上使用spi,sclk作调制器时钟,miso接收PDM信号,例如 sclk=8MHz,要实现ODR=1kSPS(8000倍抽取),则每接收50Byte(DMA到数组)进DMA完成/半完成中断,对 '1' 的位进行计数(算法需优化,最快的办法查表,输出1Byte),进入数字滤波器,输出进行20倍抽取,得到 16bit数据(12位有效);
如果不要求实时性,可以用大点的buffer,减少中断的次数,如果有硬件CRC,就更方便了~ 但总的来说,还是只适合有多余的计算资源并且成本敏感的情况,毕竟加法器 CIC FIR 都很简单,另外,stm32l4 和 adi 的一些arm自带了解调的模块

编辑原因:原叙述有误

出0入0汤圆

发表于 2016-10-14 18:00:41 来自手机 | 显示全部楼层
挺有趣的。不知道和FFT比,扫频速度上是否有优势。

出0入0汤圆

发表于 2016-10-14 18:19:19 | 显示全部楼层
支持一下,LZ继续优化优化,搞套件出来吧

建议:能做到至少1MHz带宽的网络分析仪、LCR阻抗分析,就有实用价值了。

出0入0汤圆

发表于 2016-10-14 20:07:55 | 显示全部楼层
感谢分享。。。

出5入4汤圆

发表于 2016-10-14 20:11:24 | 显示全部楼层
不错,谢谢分享

出15入186汤圆

发表于 2016-10-14 22:34:19 来自手机 | 显示全部楼层
关注,,,,,,,,,,,,,

出0入0汤圆

发表于 2016-10-14 22:57:23 | 显示全部楼层
关注。这个资料好,电桥diy

出0入0汤圆

 楼主| 发表于 2016-10-15 19:57:53 | 显示全部楼层
谢谢各位的关注和建议!100k c版本的空板届时会有一些,元件有几套 到时发帖告诉各位~
20M LCR 有新进展,可切换成简单的网分,可测bode图~ 但反射群延迟等等估计没戏~

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出0入0汤圆

发表于 2016-10-15 20:28:28 来自手机 | 显示全部楼层
mark,谢谢分享

出0入0汤圆

发表于 2016-10-15 20:55:45 | 显示全部楼层
不错,年轻有为

出0入0汤圆

发表于 2016-10-15 21:38:40 | 显示全部楼层
楼主厉害!

出0入0汤圆

发表于 2016-10-15 22:07:24 | 显示全部楼层
做的不错,做出一个来看看效果哦。

出0入0汤圆

发表于 2016-10-15 22:29:14 | 显示全部楼层
不错,DLIA这个还没接触过,先标记下,回头好好学习,感谢楼主的分享

出100入101汤圆

发表于 2016-10-15 22:34:26 | 显示全部楼层
LZ懂的蛮多的,本科就这么牛!

出0入0汤圆

发表于 2016-10-15 22:56:25 | 显示全部楼层
一天的蓝 发表于 2016-10-15 19:57
谢谢各位的关注和建议!100k c版本的空板届时会有一些,元件有几套 到时发帖告诉各位~
20M LCR 有新进展, ...

LZ  先预定一套100K版本的,20MHz版本的搞定了也预定一套。自己做点小玩意,有个网分实在是太爽了。

商用的网分都卖挺贵的,你这个如果能对比测试下,就很有说服力了。会有更多的人买。

出0入0汤圆

发表于 2016-10-15 22:56:53 | 显示全部楼层
不懂 ,学习下。

出0入0汤圆

发表于 2016-10-15 23:02:57 | 显示全部楼层
楼主高手,网上可以搜到楼主的论文吗?非常希望有机会拜读。

出0入0汤圆

发表于 2016-10-15 23:05:04 | 显示全部楼层
希望可以预定一套 100k c版本 以及元件 理解一下其中原理。

出0入12汤圆

发表于 2016-10-15 23:45:58 | 显示全部楼层
赞!有为青年

出0入0汤圆

发表于 2016-10-16 07:02:04 来自手机 | 显示全部楼层
楼主,47楼用的是什么软件?一直在找类似的东西,试过几款效果都不满意。

出0入0汤圆

发表于 2016-10-16 12:10:09 | 显示全部楼层
mark一下,lcr表。

出0入0汤圆

 楼主| 发表于 2016-10-16 13:56:02 | 显示全部楼层
wwk1996 发表于 2016-10-16 07:02
楼主,47楼用的是什么软件?一直在找类似的东西,试过几款效果都不满意。

onenote, win10 uwp,office里也有桌面版~功能更强一些,手写笔迹是因为在用surface pro 2,,

出0入0汤圆

发表于 2016-10-16 17:00:46 | 显示全部楼层
楼主有兴趣做非标自动化设备或夹具类吗?
可以加我QQ聊聊445933841

出10入18汤圆

发表于 2016-10-25 15:56:24 | 显示全部楼层
Mark,基于DLIA的LCR
如果出套件,我也预定一套

出0入0汤圆

发表于 2016-10-29 01:17:21 | 显示全部楼层
关注,支持楼主,一直想做一个LCR,找到不到合适的方案

出0入0汤圆

发表于 2016-10-29 06:53:19 | 显示全部楼层
不错,楼主年轻有为

出0入0汤圆

发表于 2016-10-29 10:16:56 | 显示全部楼层
高手 厉害

出0入0汤圆

发表于 2016-10-29 10:44:55 | 显示全部楼层
有为青年

出0入0汤圆

发表于 2016-12-22 21:24:27 | 显示全部楼层
最新进展啊.谢谢公开资料

出0入0汤圆

发表于 2016-12-22 22:01:52 | 显示全部楼层
本帖最后由 RAMILE 于 2016-12-22 22:27 编辑

以前想到直接ADV7123+FPGA 取代IV变换,可惜又笨又懒

出0入0汤圆

发表于 2016-12-22 22:10:01 | 显示全部楼层

不错,年轻有为

出0入0汤圆

发表于 2016-12-23 06:50:49 来自手机 | 显示全部楼层
学习了,谢谢

出0入0汤圆

发表于 2016-12-23 08:22:21 | 显示全部楼层
很有深度,学习了,对比自己汗颜啊!

出0入0汤圆

发表于 2016-12-23 10:16:28 | 显示全部楼层
楼主太强了。。

出0入0汤圆

发表于 2016-12-23 12:32:08 | 显示全部楼层
水平比我高

出0入0汤圆

发表于 2017-3-15 00:35:49 | 显示全部楼层
楼主出个100K 套件吧  肯定不少人需要的。

出0入0汤圆

发表于 2017-3-15 09:11:09 | 显示全部楼层
点赞,年纪轻轻如此了得,未来栋梁呀

出0入0汤圆

发表于 2017-3-15 13:11:28 | 显示全部楼层
顶, 有谁准备出套件

出0入0汤圆

发表于 2017-3-21 17:18:31 | 显示全部楼层
mark,研究了半天

出0入0汤圆

发表于 2017-3-21 21:59:00 | 显示全部楼层
好资料,mark!

出0入0汤圆

发表于 2017-3-27 14:28:34 | 显示全部楼层
谢谢分享 !

出0入0汤圆

发表于 2017-3-31 11:31:23 | 显示全部楼层
楼主实在是牛人啊!

出0入0汤圆

发表于 2017-7-18 21:50:43 | 显示全部楼层
看了帖子,稍微看了github的资料,电路结构极其简单,频率还能达到100k。
hardware 只看到了beta版本,c版本的链接失效了。
github上的software和beta的硬件版本对应的么?

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 楼主| 发表于 2017-7-21 20:01:14 | 显示全部楼层
PCBBOY1991 发表于 2017-7-18 21:50
看了帖子,稍微看了github的资料,电路结构极其简单,频率还能达到100k。
hardware 只看到了beta版本,c版 ...

是的,100k_ZLCR_beta 的sch(pdf), pcb(geber), Firmware(hex, .c),完全对应;用DSP算法实现了PSD 所以简单

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发表于 2017-7-21 20:39:39 | 显示全部楼层
mark,给力

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发表于 2017-7-21 20:45:11 | 显示全部楼层
一天的蓝 发表于 2017-7-21 20:01
是的,100k_ZLCR_beta 的sch(pdf), pcb(geber), Firmware(hex, .c),完全对应;用DSP算法实现了PSD 所以 ...

恩,那我就借你的这个开源项目入门STM32了!
在淘宝上看了这个电桥用的三个芯片,价格确实不高。
但是我注意到你的方案里边使用了音频DAC&ADC,这两个的INL和DNL对测试精度的影响能通过校准解决么?
电流检测用到了1k Ohms的电阻,这个对精度也有很大的影响吧?

出0入0汤圆

发表于 2017-7-26 09:38:42 | 显示全部楼层
谢谢分享

出0入0汤圆

发表于 2017-7-26 09:56:31 | 显示全部楼层
学习一下 准备制作

出10入95汤圆

发表于 2018-1-19 21:00:20 | 显示全部楼层
楼主牛人,多谢分享!

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发表于 2018-3-18 15:40:10 | 显示全部楼层
谢谢,楼主

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发表于 2018-3-18 18:15:51 | 显示全部楼层
mark,先做个记号

出0入0汤圆

发表于 2018-4-29 21:26:08 | 显示全部楼层
mark,谢谢分享

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发表于 2018-4-29 22:06:28 | 显示全部楼层
好资料,马克一下,有空研究

出0入0汤圆

发表于 2018-4-29 22:10:01 | 显示全部楼层
有时间研究下   

出0入0汤圆

发表于 2018-4-30 17:26:45 | 显示全部楼层
先标记一下。

出0入0汤圆

发表于 2018-5-6 00:04:28 | 显示全部楼层
MARK,谢谢分享!

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发表于 2018-5-22 20:24:09 | 显示全部楼层
上传一个在Keil下重构过的工程,编译通过,没跑通

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 楼主| 发表于 2018-5-24 20:40:48 | 显示全部楼层
桂电小手 发表于 2018-5-22 20:24
上传一个在Keil下重构过的工程,编译通过,没跑通

gcc和mdk分别编译和测试通过的,如果提供的hex也不能用,那么可以确定是硬件或上位机的问题

出0入0汤圆

 楼主| 发表于 2018-5-24 21:07:49 | 显示全部楼层
近期会有些(久违的)更新:
* 第一级滤波器切换到cic或hbf,减少运算量
* rtos/shell 支持 rt-thread(也可能是 MicroPython)
* Jupyter notebook 相关的支持

然后给自己定个小目标:20MHz,FPGA+SAR ADC方案

出0入0汤圆

发表于 2018-7-31 15:10:13 | 显示全部楼层
期待楼主的更新

出0入0汤圆

发表于 2018-8-14 15:18:53 来自手机 | 显示全部楼层
本帖最后由 fnems 于 2018-8-14 15:25 编辑

天蓝大神你好,最近我在学习你的100k ZLCR项目,感觉收获了很多新技能。

源码里面有几点没看明白:DSP文件里的数据处理,我理解是分别经过了三3次八阶IIR低通滤波并进行32倍抽样,其中前两级IIR的参数是相同的。能详细介绍一下滤波器参数是怎么确定的吗?

还有作为激励的正弦表Q15的幅值是24000,看起来比较圆整,换算成小数是0.7324;F32的赋值是1.101640e-10,这个幅值是怎么来的呢?为什么这么小而且看起来有效数字没啥规律。
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