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FPGA 的主晶振用温补晶振,但不知道用什么波形的

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出0入0汤圆

发表于 2017-4-13 16:37:48 | 显示全部楼层 |阅读模式
         目前用的温补晶振 之前用的有两种 有正弦波 和ttl方波两种 正弦波的幅度小 1V 左右  

之前同事用的是正玄波的,有没有人用过,我感觉应该用ttl的给fpga提供时钟

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出0入0汤圆

发表于 2017-4-14 11:17:31 | 显示全部楼层
用TTL..........

出0入0汤圆

发表于 2017-4-14 11:48:45 | 显示全部楼层
晶振的输出电平是和FPGA的时钟输入IO的电平相匹配的,例如FPGA时钟输入口的电平标准是3.3V,那晶振就用LVTTL的,如果FPGA的时钟输入口电平是1.8,1.5甚至更低,就建议用1V正弦波,就是取决于FPGA你用到的时钟输入IO那个BANK的供电电压。

出0入0汤圆

发表于 2017-4-14 12:35:48 | 显示全部楼层
能用正弦就不用TTL的
要不然辐射发射实验很难通过

出0入0汤圆

发表于 2017-4-14 16:04:02 | 显示全部楼层
进fpga的时钟会进pll或者dll,正弦波更好

出0入0汤圆

 楼主| 发表于 2017-4-21 08:43:08 | 显示全部楼层
qsmq46 发表于 2017-4-14 11:48
晶振的输出电平是和FPGA的时钟输入IO的电平相匹配的,例如FPGA时钟输入口的电平标准是3.3V,那晶振就用LVTT ...

我是2.5V 供电的bank ,关键是没找到文档说低幅度的信号是否可以输入

出0入0汤圆

 楼主| 发表于 2017-4-21 08:43:55 | 显示全部楼层
xjmlfm1 发表于 2017-4-14 12:35
能用正弦就不用TTL的
要不然辐射发射实验很难通过

对,正弦的幅度和尖峰少

出0入0汤圆

 楼主| 发表于 2017-4-21 08:44:37 | 显示全部楼层
7802848 发表于 2017-4-14 16:04
进fpga的时钟会进pll或者dll,正弦波更好

恩,关键是怕正弦波的幅度不行

出0入0汤圆

发表于 2017-4-21 17:16:57 来自手机 | 显示全部楼层
50兆以下用方波较好,以上则正弦波有优势辐射小。

出0入300汤圆

发表于 2017-4-24 08:29:57 来自手机 | 显示全部楼层
用尽可能纯的正弦波

出0入0汤圆

发表于 2017-4-24 14:30:30 来自手机 | 显示全部楼层
试过,2.5v供电正弦波的那种不行,幅度不够
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