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请教一下ZYNQ ADC ->AXI STREAM ->DMA 的实现

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出0入0汤圆

发表于 2018-6-25 12:57:49 | 显示全部楼层 |阅读模式
自己实验 AXI STREAM FIFO DMA LOOP 可以正常工作

ADC 接 AXI STREAM DATA FIFO  S端 TLAST TVALID 设置成常量1

DEBUG 时ADC DATA有数据 ,但是读取的时候 S_AXIS_TREADY 一直没反映。

能不能派包中华教教我,卡住了

Red Pitaya 买来好久了,想玩一下。




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一只鸟敢站在脆弱的枝条上歇脚,它依仗的不是枝条不会断,而是自己有翅膀,会飞。

出0入0汤圆

 楼主| 发表于 2018-6-25 12:58:36 | 显示全部楼层
ADC 输出只有14个DATA 两个时钟 一个输入 CLKSTB  

出0入0汤圆

 楼主| 发表于 2018-6-25 22:30:51 | 显示全部楼层
本帖最后由 gongcsf 于 2018-6-25 22:32 编辑

求助,弄了个最基本的硬件DEBUG  应该是我还没型明白AXIS TREADY信号是怎么生成的。PS端发出读后才有的吗?



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出0入0汤圆

发表于 2018-12-9 12:04:11 来自手机 | 显示全部楼层
应该是那些信号不能设置为常量吧?
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