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回复: 18

请问有没有用过可编程延迟线

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出0入0汤圆

发表于 2019-4-27 20:09:14 | 显示全部楼层 |阅读模式
请问诸位有没有用过可编程延迟线,推荐一款。问题的起因是要做几路485脉冲信号的输出,要求路间一致性要小于2ns,但看了几款485芯片,传播延迟都不确定,误差比较大,考虑用延迟线来调,望各位看官给点意见。谢谢!

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出0入0汤圆

发表于 2019-4-27 20:24:23 | 显示全部楼层
用一片CPLD做延迟就行

出0入475汤圆

发表于 2019-4-27 20:25:07 来自手机 | 显示全部楼层
用过的都是模拟信号,而且衰减极大,要是数字逻辑电平延迟,fpga自己搭吧

出0入0汤圆

发表于 2019-4-27 20:31:34 | 显示全部楼层
ds1023?
其实不一定要芯片,在驱动芯片的输入端加RC电路应该也能调延时吧。

出20入128汤圆

发表于 2019-4-27 20:33:39 | 显示全部楼层
lcw_swust 发表于 2019-4-27 20:31
ds1023?
其实不一定要芯片,在驱动芯片的输入端加RC电路应该也能调延时吧。 ...

这种级别的延时,就算测好了;批量一致性或者温度变化,都会导致差异吧?

出0入442汤圆

发表于 2019-4-27 20:46:46 来自手机 | 显示全部楼层
z123 发表于 2019-4-27 20:33
这种级别的延时,就算测好了;批量一致性或者温度变化,都会导致差异吧? ...

只要温度相近,同批次延时差不多。比如245。

出0入475汤圆

发表于 2019-4-28 13:36:33 来自手机 | 显示全部楼层
楼上的差不多太悬了啊,楼主2ns都嫌大,你的全靠器件的一致性而且还差不多,那到底是1ns还是3ns啊 :)

出0入0汤圆

发表于 2019-4-28 15:17:59 | 显示全部楼层
这要求也太精确了,2ns   485不是最终串口么,如何保证串口解码时间误差2us.  

出0入59汤圆

发表于 2019-4-28 15:27:20 | 显示全部楼层
这个还要考虑电缆长短路径延迟吧

出0入0汤圆

发表于 2019-4-28 21:41:24 | 显示全部楼层
2ns有误吧,这是什么样的要求。

出0入0汤圆

发表于 2019-4-28 21:52:05 | 显示全部楼层
本帖最后由 Scarlette 于 2019-4-28 21:53 编辑

光速才0.3m/ns,485这么长距离的玩意儿同步到2ns以内?

出0入4汤圆

发表于 2019-4-28 22:56:05 | 显示全部楼层
Scarlette 发表于 2019-4-28 21:52
光速才0.3m/ns,485这么长距离的玩意儿同步到2ns以内?

电信号在双绞线上的传输速度是4.7ns/m,比光速慢

出0入0汤圆

发表于 2019-4-28 23:00:14 | 显示全部楼层
physis 发表于 2019-4-28 22:56
电信号在双绞线上的传输速度是4.7ns/m,比光速慢

嗯,就是因为光速尚且如此,在铜线里电信号又远低于光速,所以他的需求才让我一脸懵逼啊……

出0入0汤圆

发表于 2019-4-29 09:27:01 | 显示全部楼层
长期平均值2ns,或许有可能实现。

出0入0汤圆

发表于 2019-4-29 09:46:08 | 显示全部楼层
CPLD也不好做到2ns的延迟控制吧

出0入8汤圆

发表于 2019-4-29 14:26:08 | 显示全部楼层
楼主这个是什么应用需求,有点好奇

出0入0汤圆

发表于 2019-4-29 14:26:21 | 显示全部楼层
那你为啥不用lvds发送芯片。他的差分输出延迟比485芯片强的多了。

出0入0汤圆

 楼主| 发表于 2019-5-1 09:59:45 | 显示全部楼层
wx85105157 发表于 2019-4-29 14:26
那你为啥不用lvds发送芯片。他的差分输出延迟比485芯片强的多了。

用户指定用422/485

出0入0汤圆

发表于 2019-5-2 20:30:15 | 显示全部楼层
他是要求发送出去的端口误差在2ns  还是多个通道任意线长的对端都是2ns以内?
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