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FPGA生成125K正弦频率不准毛刺大的问题

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出0入0汤圆

发表于 2020-1-26 16:19:09 | 显示全部楼层 |阅读模式
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阿莫论坛20周年了!感谢大家的支持与爱护!!

月入3000的是反美的。收入3万是亲美的。收入30万是移民美国的。收入300万是取得绿卡后回国,教唆那些3000来反美的!

出0入59汤圆

发表于 2020-1-26 17:39:33 | 显示全部楼层
好似是示波器的触发电平不对
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出0入0汤圆

 楼主| 发表于 2020-1-26 17:49:56 来自手机 | 显示全部楼层
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出0入0汤圆

发表于 2020-1-26 18:00:33 | 显示全部楼层
电源不太稳吧

出0入0汤圆

发表于 2020-1-26 18:19:06 来自手机 | 显示全部楼层
先拉个周期同步信号出来看,示波器显示频率与波形有关,看上去你的缺低通,台阶多

出0入0汤圆

发表于 2020-1-26 22:46:33 | 显示全部楼层
看看DA的数字信号高位是不是频率比较低,次低位频率稍高点,数字的没有问题了,看DA的p和n输出波形

出0入0汤圆

发表于 2020-1-27 13:00:38 | 显示全部楼层
125K 用 DS-DAC就好了,不用电阻网
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