XILINX IDDR信号输入以及约束？

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atom100

出0入0汤圆

发表于 2016-12-13 13:13:54 | 显示全部楼层 |阅读模式

本帖最后由 atom100 于 2016-12-13 13:18 编辑

rgmii输入到fpga，
时钟和数据都需要经过 iodelaye1才能送入IDDR吗？
如果时钟也经过iodelay如何进行时钟的约束？
我现在是时钟经过rgmii_clk->IBUF->IODELAYE1->IBUFR->rgmii_clk_g,
另外还输入一个时钟clk经过MMCM的，
总报时钟clk和rgmii_clk_g之间的错误，但有不能create_clock rgmii_clk_g, 来设置异步时钟组

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