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quartus ii的疑问....

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出0入0汤圆

发表于 2009-11-22 16:56:52 | 显示全部楼层 |阅读模式
在quartus ii里面进行verilog的仿真时 为什么代码写上升沿跳变 而波形图的结果是下降沿 写下降沿跳变 而结果是上升沿啊?
是不是哪设置的问题啊

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一只鸟敢站在脆弱的枝条上歇脚,它依仗的不是枝条不会断,而是自己有翅膀,会飞。

出0入0汤圆

发表于 2009-11-22 18:17:01 | 显示全部楼层
先用functing simulation 看

出0入0汤圆

 楼主| 发表于 2009-11-22 19:47:12 | 显示全部楼层
问一下 功能仿真和时序仿真有什么区别 都在什么时候用啊

出0入0汤圆

发表于 2009-12-3 09:59:58 | 显示全部楼层
功能仿真不考虑器件延时,是理想情况下的仿真结果。时序仿真考虑器件延时,是下载到器件中真实的运行结果
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