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CPLD输出几HZ的方波怎样实现才能耗资源最少?

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出0入0汤圆

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发表于 2015-11-13 09:18:20 | 显示全部楼层
楼主,我绝对不相信,既然用了EPM570,不会连这么个计数器都变成非常耗资源的东西.
如果非要省,可以多个计数器级联,虽然D触发器会浪费一点,但是组合逻辑会少一些

阿莫论坛20周年了!感谢大家的支持与爱护!!

曾经有一段真挚的爱情摆在我的面前,我没有珍惜,现在想起来,还好我没有珍惜……

出0入0汤圆

2
发表于 2015-11-13 15:28:16 | 显示全部楼层
linbo411 发表于 2015-11-13 09:29
我的意思怎么写才是最省,这个也是优化设计

其实怎么写才最省,这个基本上无止境的
你可以写几个版本试试
肯定都是计数器,只是分几级,以及每级分多少分频系数
就是触发器与组合逻辑的折中
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