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zynq的ddr3阻抗匹配问题,有量产经验的进来指导下。

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出0入115汤圆

发表于 2023-6-9 10:39:00 | 显示全部楼层 |阅读模式
xc7z010/xc7z010系列的ddr3地址线阻抗端接电阻都是40.2R,官方UG933建议ddr3也是单端40,差分80,现在我的问题是单端40差分80的阻抗,找了好几家pcb板厂(相对便宜的)线宽都要7mil以上,bga400扇出相当困难。如果阻抗用50,100要好弄很多,有没有大佬实际的量产经验,这部分ddr3阻抗用50,100会不会不稳定?

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曾经有一段真挚的爱情摆在我的面前,我没有珍惜,现在想起来,还好我没有珍惜……

出10入18汤圆

发表于 2023-6-9 10:44:33 | 显示全部楼层
下载EBAZ4205的资料PCB看看。那个可是量产的。

出0入0汤圆

发表于 2023-6-9 12:44:42 来自手机 | 显示全部楼层
要求没那么高,顶多533/1066,50/100欧没问题的

出0入115汤圆

 楼主| 发表于 2023-6-9 18:59:19 来自手机 | 显示全部楼层
zynq布线真麻烦,比全志啥的难搞

出10入12汤圆

发表于 2023-6-10 00:58:34 | 显示全部楼层
本帖最后由 hugohehuan 于 2023-6-10 01:03 编辑

一看就知道是只想着DDR走表层的……
显然那是行不通的
4层板除非管脚利用率很低,也不要想了

某个厂0.8mm的6层板就有层叠走内层40ohm阻抗差不多就是5mil左右,都不用另外加钱的

Zynq-7000布线算很容易的了
而且硬件设计只要符合手册要求,自己想怎么设计就怎么设计
不会像国内某些ARM SoC这不能改那不能改的,稍微改个东西出了问题就推卸不是自己的问题

还觉得困难就换成1.0mm pitch的484封装吧,也挺常见的。

出0入0汤圆

发表于 2023-6-10 08:40:52 | 显示全部楼层
BGA扇出可以变线宽,另外同意3楼说的

出0入0汤圆

发表于 2023-6-11 09:31:58 来自手机 | 显示全部楼层
用最薄的芯板和Pp做叠层就可以缩小线宽。
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