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学生的课程设计作品

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出0入0汤圆

发表于 2010-7-15 18:31:49 | 显示全部楼层 |阅读模式
刚学完《数字电路》的学生,用了不到两个星期,从零开始用Quartus II,学习Verilog编程,通过几个小实验的训练,最终完成了一个数字钟的综合实验。

数字钟具有计时、闹铃、秒表、倒计时的功能,本打算只让他们使用SignalTap II采内部计数信号,进行模拟显示。有几个女学生比较生猛,比大部分人提前了两天的时间,于是就让她们每个组自己动手焊接了一块LED显示板。

做得最快的一组时钟显示效果如下:


正面 (原文件名:DSC02802N.jpg)

电路板背面:


背面 (原文件名:DSC02800N.jpg)

实验板是从阿莫邮购部买的,背面的导线也是从阿莫邮购部买的,都挺好用。特别是这些成品的实验焊线,省了学生自己裁线、剥线、镀锡的环节,大大提高了实验效率

阿莫论坛20周年了!感谢大家的支持与爱护!!

一只鸟敢站在脆弱的枝条上歇脚,它依仗的不是枝条不会断,而是自己有翅膀,会飞。

出0入4汤圆

发表于 2010-7-15 19:05:57 | 显示全部楼层
老师教的好,呵呵

出0入0汤圆

发表于 2010-7-15 19:56:24 | 显示全部楼层
记得我们数电数字钟实验 完全用74芯片搭起来,100多根导线在面包板上插,时钟电路用555.时 分 秒 时间修正等等

出0入0汤圆

 楼主| 发表于 2010-7-15 20:48:53 | 显示全部楼层
回复【2楼】gibson08
记得我们数电数字钟实验 完全用74芯片搭起来,100多根导线在面包板上插,时钟电路用555.时 分 秒 时间修正等等
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这种面包板实验很经典,可惜做实验过程中,没有几个学生会借助万用表或示波器来检查信号电平,排查问题

这次课程设计,除了进行模块仿真,学生们还学会了使用SignalTap II来观察真实的信号输入与输出之间的关系


现在孩子们的学习条件真好,当年哥上EDA实验课,也就是在MaxPlusII上跑跑仿真,哪有机会见识CPLD、FPGA长啥样,哎`

出0入0汤圆

发表于 2010-7-15 20:51:07 | 显示全部楼层
好。

出0入0汤圆

发表于 2010-7-15 20:51:37 | 显示全部楼层
路过顶一下

出0入0汤圆

发表于 2010-7-16 11:50:09 | 显示全部楼层
看到这样的跳线,就让我想起了以前。呵
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